在主模式下，FPGA在上电后自动从外部非易失性存储器中读取配置数据到内部SRAM中，实现内部结构的映射。这种模式根据比特流的位宽不同，又可分为串行模式和并行模式。串行模式中，只有一个比特流传输；而并行模式则使用字节宽度的比特流。例如，主串行模式、主SPI Flash串行模式、内部主SPI Flash串行模式、主BPI并行模式和主并行模式等。
从模式则有所不同，FPGA作为从属器件，由外部的控制电路或微处理器提供配置所需的时序，实现配置数据的下载。从模式同样根据比特流的位宽不同，分为串行和并行两大类，包括从串行模式、JTAG模式和从并行模式。
JTAG模式是一种特殊的调试模式，利用JTAG接口的TCLK时钟信号，将PC中的比特流文件下载到FPGA中。这种模式的特点是配置数据断电即丢失，适用于调试和测试阶段。
FPGA的配置电路设计中，赛灵思公司提供了多种配置模式，包括主串模式、从串模式、SeLECt MAP模式、Desktop配置和直接SPI配置。以下是一些常见模式的详细解读。
主串模式是最常用的一种配置方式，其工作原理是由FPGA的CCLK管脚提供时钟信号给PROM（ programmable read-only memory），PROM在CCLK的上升沿将数据从D0管脚传送到FPGA的DIN管脚。即使PROM支持并行配置，在主串模式中也只利用其串行配置功能。
在配置单片FPGA时，主串模式的电路相对简单。然而，要确保配置成功，需要注意几个关键点：首先是JTAG链的完整性，其次是电源电压的设置，最后是CCLK信号的稳定性。
JTAG链的完整性是指将JTAG连接器、FPGA和PROM的TMS、TCK信号连在一起，形成一个闭合的回路。这样，从JTAG连接器的TDI到TDO之间就能形成一个连续的路径，确保数据能够正确传输。
电源适配性也非常重要，因为不同的FPGA和PROM可能需要不同的电压。确保电源适配正确，可以避免配置过程中出现的问题。
此外，CCLK信号作为配置时钟，其稳定性直接影响配置过程。确保CCLK信号稳定，可以减少配置失败的可能性。
在Select MAP模式中，配置数据是并行的，这使得它成为速度最快的配置模式。SPI配置模式则主要在具有SPI接口的FLASH电路中使用。
在多片FPGA配置时，菊花链配置方式可以实现共享同一块外部存储器，或从多片外部存储器中读取配置数据和用户自定义数据。这种灵活性使得FPGA在复杂系统中具有更大的应用潜力。
总之，FPGA的配置方式灵活多样，能够适应不同应用场景的需求。了解和掌握这些配置模式，对于开发高效、可靠的FPGA系统至关重要。
FPGA配置方式灵活多样，根据芯片是否能够自己主动加载配置数据分为主模式、从模式以及JTAG模式。典型的主模式都是加载片外非易失( 断电不丢数据) 性存储器中的配置比特流，配置所需的时钟信号( 称为CCLK) 由FPGA内部产生，且FPGA控制整个配置过程。从模式需要外部的主智能终端( 如处理器、微控制器或者DSP等) 将数据下载到FPGA中，其最大的优点就是FPGA 的配置数据可以放在系统的任何存储部位，包括：Flash、硬盘、网络，甚至在其余处理器的运行代码中。JTAG 模式为调试模式，可将PC 中的比特文件流下载到FPGA中，断电即丢失。此外，目前赛灵思还有基于Internet 的、成熟的可重构逻辑技术System ACE解决方案。
(1) 主模式
在主模式下，FPGA上电后，自动将配置数据从相应的外存储器读入到SRAM中，实现内部结构映射；主模式根据比特流的位宽又可以分为：串行模式( 单比特流) 和并行模式( 字节宽度比特流) 两大类。如：主串行模式、主SPI Flash 串行模式、内部主SPI Flash串行模式、主BPI 并行模式以及主并行模式，如图5-19所示。
(2) 从模式
在从模式下，FPGA 作为从属器件，由相应的控制电路或微处理器提供配置所需的时序，实现配置数据的下载。从模式也根据比特流的位宽不同分为串、并模式两类，具体包括：从串行模式、JTAG模式和从并行模式三大类，其概要说明如图5-20所示。
(3)JTAG模式
在JTAG模式中，PC和FPGA通信的时钟为JTAG接口的TCLK，数据直接从TDI进入FPGA，完成相应功能的配置。
图5-19 常用主模式下载方式示意图
图5-20 常用的从模式下载方式示意图
目前，主流的FPGA芯片都支持各类常用的主、从配置模式以及JTAG，以减少配置电路失配性对整体系统的影响。在主配置模式中，FPGA自己产生时钟，并从外部存储器中加载配置数据，其位宽可以为单比特或者字节；在从模式中，外部的处理器通过同步串行接口，按照比特或字节宽度将配置数据送入FPGA芯片。此外，多片FPGA可以通过JTAG菊花链的形式共享同一块外部存储器，同样一片/ 多片FPGA也可以从多片外部存储器中读取配置数据以及用户自定义数据。
Xilinx FPGA的常用配置模式有5 类：主串模式、从串模式、Select MAP模式、Desktop配置和直接SPI配置。在从串配置中，FPGA接收来自于外部PROM或其它器件的配置比特数据，在FPGA产生的时钟CCLK的作用下完成配置，多个FPGA可以形成菊花链，从同一配置源中获取数据。Select MAP模式中配置数据是并行的，是速度最快的配置模式。SPI配置主要在具有SPI接口的FLASH电路中使用。下面以Spartan-3E系列芯片为例，给出各种模式的配置电路。
主串模式——最常用的FPGA配置模式
1．配置单片FPGA
在主串模式下，由FPGA的CCLK管脚给PROM提供工作时钟，相应的PROM在CCLK的上升沿将数据从D0管脚送到FPGA的DIN管脚。无论PROM芯片类型( 即使其支持并行配置)，都只利用其串行配置功能。Spartan3E系列FPGA的单片主串配置电路如图5-21所示。主串模式是赛灵思公司各种配置方式中最简单，也最常用的方式，基本所有的可编程芯片都支持主串模式。
图5-21 Spartan-3E主串模式配置电路
2．配置电路的关键点
主串配置电路最关键的3点就是JTAG链的完整性、电源电压的设置以及CCLK信号的考虑。只要这3步任何一个环节出现问题，都不能正确配置PROM芯片。
(1)JTAG链的完整性
FPGA和PROM芯片都有自身的JTAG接口电路，所谓的JTAG链完整性指的是将JTAG连接器、FPGA、PROM的TMS、TCK连在一起，保证从JTAG连接器TDI到其TDO之间，形成JTAG连接器的“TDI →(TDI~TDO) → (TDI~TDO) → JTAG连接器TDO”的闭合回路，其中(TDI~TDO) 为FPGA或者PROM芯片自身的一对输入、输出管脚。图5-12中配置电路的JTAG链从连接器的TDI到FPGA的TDI，再从FPGA的TDO到PROM的TDI，最后从PROM的TDO到连接器的TDO，形成了完整的JTAG链，FPGA芯片被称为链首芯片。也可以根据需要调换FPGA和PROM的位置，使PROM成为链首芯片。
(2) 电源适配性
